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主要特征:
以全流水线结构来实现JPEG图像压缩, 大幅提高了系统的运行效率。
通过优化设计, 显著降低了全功能JPEG压缩核对于FPGA资源的占用, 可应用于低功耗低成本的FPGA。在低成本FPGA上, 也可同时实时压缩多路高清图像流。
接口设计采用AXI4 通用接口, 易于系统集成。
支持同时集成多个JPEG图像压缩核, 提升处理能力。
最大分辨率支持 64K*64K 超大图像。
支持可编程霍夫曼编码表, 支持可调节的图像压缩率, 满足不用应用场景下对于图像质量和压缩码流的需求。
提供可直接运行测试的软硬件平台。
JPEG压缩IP核 下载